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如何写好Verilog状态机

时间:2024-10-13 12:08:17

1、状态机描述主要有以下几个方面,即如何进行状态转移,状态转移的条件,每个状态的输出是什么;而最佳的状态机就是将三者分开,由组合逻辑和非组合逻辑搭配组成,这样程序易读,易维护,同时方便添加约束条件。

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2、第一段状态,时序电路的always模块,用同步电路描述状态跳转的过程,这样可利用触发器消除不稳定状态。

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3、第二段状态,组合逻辑always模块,用以描述状态转移的判断条件,利用组合逻辑实现,达到立即判断的效果,在下一时钟边沿同步变化

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4、第三段状态,时序电路always模块,用以描述每一段状态的结果输出,使用时序电路实现,消除不稳定状态的变化,达到同步跳转的效果

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5、三段式状态机做到了同曰搬嚏嘀步寄存器输出,消除了组合逻辑输出的不稳定与毛刺的隐患,而且更利于时序路径分组,在FPGA的综合与布局布线效果更佳,提高电路运行时钟,加大布线成功率。

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